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Geração de código e síntese de instruções para processadores dedicados

Processo: 99/09462-8
Linha de fomento:Bolsas no Brasil - Doutorado
Vigência (Início): 01 de março de 2000
Vigência (Término): 30 de junho de 2002
Área do conhecimento:Ciências Exatas e da Terra - Ciência da Computação - Sistemas de Computação
Pesquisador responsável:Guido Costa Souza de Araújo
Beneficiário:Rodolfo Jardim de Azevedo
Instituição-sede: Instituto de Computação (IC). Universidade Estadual de Campinas (UNICAMP). Campinas , SP, Brasil

Resumo

Processadores dedicados são arquiteturas voltadas para classes de aplicações. Estes processadores vem ganhando uma importância considerável devido ao papel que desempenham no projeto de sistemas de Telecomunicações (ex. telefones celulares) e Multimedia (ex. cartões gráficos). Dado que muitos destes sistemas são voltados para o mercado de consumo de larga escala, processadores dedicados devem ser baratos e possuir alto desempenho. A maneira de se conseguir isto é especializando o conjunto de instruções do processador para a aplicação alvo. O objetivo deste projeto é propor uma solução para o problema de síntese de instruções a partir de uma dada aplicação. Isto será feito através da identificação (via representação intermediária no compilador) de instruções que aparecem com freqüência no programa fonte, e inserção de código novo na descrição em VHDL/Verilog de um processador básico (MIPS). Este projeto faz parte de uma colaboração (SPAM) com universidades nos EUA (Princeton, MIT e UC Berkeley) e de um projeto de colaboração CNPq/NSF entre a UNICAMP e estas universidades. (AU)

Publicações acadêmicas
(Referências obtidas automaticamente das Instituições de Ensino e Pesquisa do Estado de São Paulo)
AZEVEDO, Rodolfo Jardim de. Uma arquitetura para execução de codigo comprimido em sistemas dedicados. 2002. Tese de Doutorado - Universidade Estadual de Campinas (UNICAMP). Instituto de Computação.

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