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Leandro de Souza Rosa

CV Lattes


Universidade de São Paulo (USP). Instituto de Ciências Matemáticas e de Computação (ICMC)  (Instituição-sede da última proposta de pesquisa)
País de origem: Brasil

Atualmente é aluno no curso de Engenharia de Computação na Universidade de São Paulo, em São Carlos e Estagiário na Empresa AMDOCS Brasil LTDA. POssuí, também dois anos de Bacharelado em Física Médica na Universidade de São Paulo, em Ribeirão Preto. Entre 2011 e 2012 estudou na Universidade do Porto, Portugal, através do Programa de Mobilidade Internacional Santander. Entre 2012 e 2013 realizou um estágio de pesquisa no exterior, financiado pela FAPESP, na Universidade da Califórnia do Sul, Estados Unidos da América, onde desenvolveu estudos e pesquisas sobre arquiteturas sistólicas para sistemas embarcados. Desenvolveu 4 Iniciações Científicas, sendo 3 financiadas pela FAPESP e uma pelo CNPq. Dois dos projetos foram na área da matemática e, os outros dois, na área da computação, com ênfase em sistemas embarcados. (Fonte: Currículo Lattes)

Bolsas no país
Bolsas no Exterior
Apoio FAPESP em números * Quantidades atualizadas em 18/01/2020
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Palavras-chave utilizadas pelo pesquisador
Publicações resultantes de Auxílios e Bolsas sob responsabilidade do(a) pesquisador(a) (3)

(Referências obtidas automaticamente do Web of Science e do SciELO, por meio da informação sobre o financiamento pela FAPESP e o número do processo correspondente, incluída na publicação pelos autores)

Publicações3
Citações2
Cit./Artigo0,7
Dados do Web of Science

ROSA, LEANDRO DE SOUZA; DASU, ARAVIND; DINIZ, PEDRO C.; BONATO, VANDERLEI. A Faddeev Systolic Array for EKF-SLAM and its Arithmetic Data Representation Impact on FPGA. Journal of Signal Processing Systems for Signal Image and Video Technology, v. 90, n. 3, p. 357-369, . Citações Web of Science: 0.

ROSA, L. S.; DELBEM, A. C. B.; TOLEDO, C. F. M.; BONATO, V.. Design and analysis of evolutionary bit-length optimization algorithms for floating to fixed-point conversion. APPLIED SOFT COMPUTING, v. 49, p. 447-461, . Citações Web of Science: 2.

ROSA, LEANDRO DE SOUZA; BOUGANIS, CHRISTOS-SAVVAS; BONATO, VANDERLEI. Scaling Up Modulo Scheduling for High-Level Synthesis. IEEE TRANSACTIONS ON COMPUTER-AIDED DESIGN OF INTEGRATED CIRCUITS AND SYSTEMS, v. 38, n. 5, p. 912-925, . Citações Web of Science: 0.

Publicações acadêmicas

(Referências obtidas automaticamente das Instituições de Ensino e Pesquisa do Estado de São Paulo)

ROSA, Leandro de Souza. Exploração Rápida de Códigos para Processamento Pipeline em Aceleradores FPGA. 2019. Tese (Doutorado) – Instituto de Ciências Matemáticas e de Computação. Universidade de São Paulo (USP). São Carlos.

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