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Graduado em Engenharia Eletrônica pelo Instituto Tecnológico de Aeronáutica (1992). Possui experiência de mais de 17 anos no desenvolvimento de sistemas eletrônicos, principalmente focados no desenvolvimento de chips dedicados (ASICs) incluindo SoC (System-on-a-Chip). Atuante em várias áreas do projeto de um chip tais como: arquitetura de sistema, definição, codificação RTL, análise de Power/Performance, integração de IPs, síntese, verificação funcional e gate-level, prototipação em FPGA, interface com SW, documentação e testes de protótipos. Especialidades: Líder de projetos de ASICs e FPGAs. VHDL, Modelsim, STA, PrimeTime, Cadence Encounter, Verilog, Synopsys, Intel XScale, C, ARM e AMBA, (Fonte: Currículo Lattes)
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